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前言
一、vinst是什么？
二、使用步驟
1.設定Vivado啟動時自動加載腳本
2.Vivado設定
總結
前言
天下苦Vivado無代碼例化模板久矣，士可996，但不可無生產力工具，這里開源一個Verilog例化模板生成腳本vinst，便于直接集成到Vivado中，
一、vinst是什么？
vinst是一個TCL腳本，用于Verilog例化模板生成，下載地址如下，
https://github.com/telantan/script.git
二、使用步驟
1.設定Vivado啟動時自動加載腳本
進入下面目錄，
%APPDATA%/Xilinx/Vivado/
新建init.tcl檔案，輸入如下內容，注意腳本路徑切換成本地真實地址，
source {E:\Vivado\script\ver_inst.tcl} -notrace2.Vivado設定
啟動Vivado，注意TCL Console中如果顯示類似如下資訊，說明啟動腳本加載成功，
INFO: [Common 17-1460] Use of init.tcl in C:/Users/Y7000P/AppData/Roaming/Xilinx/Vivado/init.tcl is deprecated. Please use Vivado_init.tcl
Sourcing tcl script 'C:/Users/Y7000P/AppData/Roaming/Xilinx/Vivado/init.tcl'Tools -> Custom Commands -> Customize Commands，
Run command 輸入以下命令，可以選擇加-p0 ，-p1或者-pa等引數，具體區別，自己嘗試
vinst [get_selected_objects]
確認以后，工具列會多一個TCL圖示，
在Sources視窗中，選中一個verilog代碼，點擊工具列中新添加的按鈕，
在TCL Console視窗中，會出現類似下面內容，具體怎么用，自己選擇，
如果添加-p1引數，
vinst [get_selected_objects] -p1
總結
通過vinst腳本，可以在Vivado中實作一鍵生成Verilog例化代碼，還算方便，當然，腳本必然有很多功能限制，bug也不少，正如人無完人，腳本亦如此，
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