在做FPGA控制AD7768采集的時候，輸出信號dclk和drdy信號正確，但是dout0-7都不正確，dout0-3始終低電平，dout6-7高電平，dout4是一個周期的高低電平變化，反正就是不正確，有做過這個AD7768的嗎？
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同樣使用AD7768，現在還看驅動代碼uj5u.com熱心網友回復：
資料輸出方面，一般不會直接有什么問題，只需要注意FORMAT0、FORMAT1和你需要的輸入格式匹配就成。uj5u.com熱心網友回復：
樓主有參考代碼么？我的dclk，drdy都正確，資料就是出不來uj5u.com熱心網友回復：
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標籤：硬件設計
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